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portada Implementazione ASIC del moltiplicatore di Pezaris nelle architetture FFT DIT (in Italian)
Type
Physical Book
Author
Publisher
Language
Italian
Pages
52
Format
Paperback
Dimensions
22.9 x 15.2 x 0.3 cm
Weight
0.09 kg.
ISBN13
9786205647899
Categories

Implementazione ASIC del moltiplicatore di Pezaris nelle architetture FFT DIT (in Italian)

Saranya Karunamurthi (Author) · Vinoth Kumar Bojan (Author) · Baby Janagam Ramachandran (Author) · Edizioni Sapienza · Paperback

Implementazione ASIC del moltiplicatore di Pezaris nelle architetture FFT DIT (in Italian) - Karunamurthi, Saranya ; Bojan, Vinoth Kumar ; Ramachandran, Baby Janagam

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Synopsis "Implementazione ASIC del moltiplicatore di Pezaris nelle architetture FFT DIT (in Italian)"

I moltiplicatori con grandi lunghezze di bit hanno un grande impatto sulle prestazioni dei circuiti digitali in molte applicazioni come la crittografia, l'elaborazione digitale dei segnali e l'elaborazione delle immagini. Le prestazioni di molti problemi di calcolo sono spesso dominate dalla velocità di esecuzione di un'operazione di moltiplicazione. Questo libro offre una breve panoramica di vari moltiplicatori come Baugh Wooley, Pezaris, Array, Booth, moltiplicatori vedici e moltiplicatori basati su compressori. L'obiettivo principale è quello di confrontare i vari tipi di moltiplicatori in termini di consumo energetico, area e ritardo. Questi concetti di moltiplicazione firmata sono implementati in Verilog HDL e realizzati in Cadence RTL Compiler con tecnologia a 180 nm.

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